Working in Lab

2013年11月26日火曜日

CMOSコンパレータ評価シミュレーション from Tsuyoshi Horigome

CMOSコンパレータ評価シミュレーションの事例です。
このような評価回路のケースもあります。

PSpiceの事例です。

PSpiceのネットリストの表記 from Tsuyoshi Horigome

こういう記述方法だったのか。ようやく、等価回路のエラー回避。

CMOSコンパレータの挙動について from Tsuyoshi Horigome

2社の半導体メーカーのデータシートを調査した。

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時間的な制御スイッチの事例です。今回の等価回路には使用できません。
ある時間の制御ですので、バッテリーの制御のアプリケーション回路の
シミュレーションで活用できそうです。

Level Shiftersの回路シミュレーション、VDD=10[V]にすると
再現性がうまれない。
ゲートレベルでデバイスモデリングを行い、不具合が解消するか
を確認する必要がある。

R&D by Tsuyoshi Horigome 04OCT2013 from Tsuyoshi Horigome

今日の進捗はかんばしくない。明日、回路を再度、検証を行う。